1樓：示鴻拜雨雪
觸發器。是具有記憶功能的二進位。
儲存器件，是各種時序邏輯電路。
的基本器件之一。其結構有同步、主從、維持阻塞等三種電路。觸發器按功能可分為rs觸發器，jk觸發器，d觸發器和t觸發器等；按電路的觸發方式可分為主—從觸發器和邊沿觸發器（包括上公升邊沿觸發器和下降邊沿咐裂觸發器）兩大類。
目前我國生產的ttl整合觸發器主要有邊沿d觸發器，邊沿jk觸發器與主—從jk觸發器等。利用這些觸發器可以轉換成其他功能的觸發器，但轉換成的觸發缺簡搭器其觸發方式並不改變。例如由邊沿變換來的仍是邊沿觸發方式的觸發器。
由兩個與非門。
交叉耦合而成的基本rs觸發器是各種觸發器的最基本組成部分，能儲存一位二進位資訊，但存在r+s=1的約束條件，即r端與s端的輸入訊號不能同時為0。
乙個整合觸發器通常有三種輸入端，第一種是非同步置位、復位輸入端，用sd、rd表示。如輸入端有乙個圈，則表示用低電平驅動，當sd或rd端有驅動訊號時，觸發器的狀態不受時鐘脈衝與控制輸入端所處狀態的影響。第二種是時鐘輸入端，用cp表示，在sdrd=1情況下，只有cp脈衝作用時才能使伏拿觸發器狀態更新。
如cp輸入端沒有小圈，表示在cp脈衝上公升沿時觸發器狀態更新，如cp輸入端有小圈，則表示在cp脈衝下公升沿時觸發器狀態更新。第三種是控制輸入端，用d、j、k等表示。加在控制輸入端的訊號是觸發器狀態更新的依據。
2樓：網友
這個要看組成d觸發器的mos管採用的擾局察工藝了，也就是看線臘悉寬，線寬越小工作頻率越高！以下工作到100m應該是沒問題的，前提是組緩茄合邏輯不要太多才可以！
什麼是d觸發器? jk觸發器的作用是什麼?
3樓：南霸天
j-k觸發器的邏輯功能：
jk觸發器再有時鐘脈衝作衫粗用時（cp=1）當j=0 k=0時狀態保持不變。
當j= 0 k=1時次態為0態。
當j=1 k=0時次態為1態。
當j=1 k=1時次態與現態相反。
d觸發器（由與非門構成）：當d=1時，q=0；當d=0時，q=1；
d觸發器的邏輯功能：
當sd=1且rd=0時(sd的非為0，rd的非為1，即在兩個控制埠分別從外部輸入的電平值，原因是低電平有效),不論腔塌拆輸入端d為何種狀態，都會使q=0，q非=1，即觸發器置0；當sd=0且rd=1(sd的非為1，rd的非為0）時，q=1，q非=0，觸發器置1,sd和rd通常又稱為直接置1和置0端。我們設它們均已加入了高電平，不影響電路的工作。
伍棗。
D觸發器Q和 Q同時輸出嗎？
這倆個觸發器是不能同時輸出的，這倆個只能分開輸出。應該是沒有辦法同時輸出的，因為他們兩個之間還是會有一些其他的過程，所以我覺得肯定是不能一起的。地處87q和q，同時輸出的話，這樣是不能的，因為d觸發器，他是一個輸出和輸入兩個同時作用的裝置。觸發器的這兩個埠是同時輸出的。在瞬時電壓完成調整的時候，它...
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設計電路最基本的原則就是可靠性，所以合格的電路不會出現資料與時鐘同時變化。一定是資料穩定後時鐘到來，即資料比時鐘早到。如果同時變化則鎖存的資料不確定。這是不允許的。數位電路中d與q的含義 觸發器具有記憶功能，是構成時序邏輯的基本單元，d 是觸發器 計數器 儲存器 的資料輸入訊號 q 是觸發器的資料輸...