1樓:匿名使用者
時鐘訊號不出bai現在卡諾圖裡du。分析時序電路zhi時通常將時序和邏輯dao拆分開來,邏輯版是在時鐘沿上執行權而已。如果同時存在同步邏輯和非同步邏輯,要分開分析。
分析同步邏輯時,把上一個時鐘週期時的狀態看成是邏輯輸入的一部分,然後用卡諾圖化簡。
q(n+1)=sr'+s'r'd (cp上升)qn=sr'+qns'r' (這個我也不清楚怎麼寫......一般都只有列表)
如何設定j-k觸發器和d觸發器的初始狀態
2樓:懵懂遊客
初始狀態要bai看你的要求了。用74系列舉du例zhi來說,7474雙d觸發器和7476雙j-k觸發器的初dao始狀回態設定方法是一樣的。查答
真值表,preset為0,clear為1時,q為1;preset為1,clear為0時q為0;preset 和 clear 皆為0 非法;preset 和 clear 皆為1 是常態。q非當然是q的相反值了。
這不好記。可以這樣想:preset 和 clear 是用來設定初始狀態的,高電平不影響輸出。
兩個都低不允許。preset 低,q就高。clear 低,q就低。
設定完,兩個都高,可以開始工作。
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