數位電路用74ls151設計四位奇校驗邏輯電路過

2021-03-11 19:18:16 字數 1731 閱讀 7793

1樓:楊必宇

真值表:

abcd y

0000 0

0001 1

0010 1

0011 0

0100 1

0101 0

0110 0

0111 1

1000 1

1001 0

1010 0

1011 1

1100 0

1101 1

1110 1

1111 0

表示式:

y=a』

e68a84e8a2ad62616964757a686964616f31333431356135b』c』d+a』b』cd』+a』bc』d』+ab』c』d』+abcd』+abc』d+ab』cd+a』bcd,

連線圖:

74151的端子a2、a1、a0分別接a、b、c,74151的端子d0、d3、d5、d6接d,d1、d2、d4、d7接d』,

74151的輸出端為y。

2樓:飛龍在天

下圖表示出了74ls151 八選一資料

選擇器的引腳圖及其真值表。圖中d0 ~d7是八個內資料輸入端

容,g』是選通輸入端(又稱使能端),cba是三個地址碼選擇輸入端,y是同相輸出端,w是反向輸出端。x表示隨意態。g』=1時,禁止工作,y端輸出始終為0,w端輸出始終為1;g』=0

時,資料選擇器正常工作。

3樓:匿名使用者

真值zhi表:

abcd y

0000 0

0001 1

0010 1

0011 0

0100 1

0101 0

0110 0

0111 1

1000 1

1001 0

1010 0

1011 1

1100 0

1101 1

1110 1

1111 0

表示式:

y=a』daob』c』d+a』b』cd』+版a』bc』d』+ab』c』d』+abcd』+abc』d+ab』cd+a』bcd,

連線權圖:

74151的端子a2、a1、a0分別接a、b、c,74151的端子d0、d3、d5、d6接d,d1、d2、d4、d7接d』,

74151的輸出端為y。

利用74ls151設計一個組合邏輯電路,輸入為4位二進位制數,當輸入能被2或5整除時,輸出為1

4樓:匿名使用者

這個問題很有趣,不知是作業還是要解決實際問題?

見圖,分析應該不難吧?

唯一一點就是0算不算被2或5整除,若是,則不需改動,若否,則將i0(第四腳)接低電平。

用八選一資料選擇器74ls151和閘電路設計一個電路圖,

5樓:匿名使用者

設 0可被2或5整除,要求電路真值表如圖,對比74ls151真值表得出邏輯電路圖。

試用如圖所示74ls151,設計一個組合邏輯電路,它接收3位二進位制數b2,b1,b0,僅當b2b1 30

6樓:無畏無知者

將b2b1b0對應於晶片選擇端a2a1a0,然後檢視晶片真值表,圈選出a2a1a0<2,及a2a1a0>5的對應的 di 輸入端,把這些圈選出的 di 接高電平,即是 di=1 就是了;

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